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English(EN) An Open Implementation Flow for the Xilinx Spartan-3E and Spartan-6 that Runs in the Browser, Checked Byte for Byte Against ISE

开源 FPGA 工具链可在浏览器中运行，与 Xilinx 位流匹配

作者 PulseAugur 编辑部 · [1 个来源] ·

已开发出一种面向 Xilinx Spartan-3E 和 Spartan-6 FPGA 的新型开源实现流程，允许用户直接在网页浏览器中生成位流。该流程利用了编译到 WebAssembly 的 Yosys 和 nextpnr，并整合了源自 Xilinx 专有工具的架构数据。该系统已与官方 ISE 14.7 工具链进行了严格验证，确保了逐字节相同的位流输出和干净的设计规则检查。在各种开源设计上的性能比较显示，与 ISE 相比，新流程使用的 slice 更少，关键路径更短，具体取决于优化目标。 AI

影响 使更广泛的 FPGA 开发得以实现，并可能加速基于硬件的人工智能研究。

排序理由 该条目描述了一篇学术论文，详细介绍了一种面向硬件描述语言的新型开源实现流程。[lever_c_demoted from research: ic=1 ai=0.4]

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报道来源 [1]

  1. arXiv cs.AI TIER_1 English(EN) · Pedro Malo ·

    Xilinx Spartan-3E 和 Spartan-6 的开放实现流程，可在浏览器中运行，并逐字节与 ISE 进行核对

    arXiv:2611.13008v1 Announce Type: cross Abstract: The author describes an open implementation flow, from HDL to a programmable bitstream, for the Xilinx Spartan-3E (XC3S100E to XC3S1200E) and Spartan-6 (XC6SLX16, XC6SLX45), devices that only the discontinued ISE 14.7 supports. Th…

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