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TOOL · CL_82632 · Jun 10 · 04:00

AI驱动的Verilog硬件设计开源数据集发布

研究人员发布了OpenRTLSet，这是一个大型开源数据集，包含超过131,000个用于硬件设计的Verilog代码样本。该数据集包括Verilog、VHDL和C/C++的翻译，以及由DeepSeek-R1模型生成的自然语言描述。该资源旨在促进语言模型在Verilog代码生成方面的微调，并展示了开源方法在硬件设计中的潜力。