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TOOL · CL_109656 · Jun 24 · 08:08

PatchINR 方法将 INR 推理延迟降低了 75%

研究人员开发了 PatchINR，一种用于隐式神经表示 (INR) 的新颖方法，可显著降低高分辨率信号建模的计算成本。通过将不重叠的块作为基本单元进行处理，并在单次前向传播中预测整个像素块，PatchINR 极大地减少了所需的推理查询次数。该方法在参数开销极小的情况下，实现了与传统像素级 INR 相当的重建质量，同时将推理延迟降低了 75%。此外，还提出了一种基于现场可编程门阵列 (FPGA) 的硬件加速架构，以进一步提高这种基于块的…