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TOOL · CL_322447 · Oct 23 · 01:45

用于脉冲神经网络的FPGA加速器采用minifloat算术

研究人员开发了一种新的脉冲神经网络（SNNs）硬件加速器架构，该架构利用参数化minifloat算术。这种设计允许可配置的精度，从而在准确性、内存和功耗之间进行权衡。FPGA实现结果表明，降低minifloat精度可显著减少资源利用率和功耗，而硬件验证案例表明，在不牺牲有竞争力的推理准确性的情况下，可以实现大幅度的精度降低。